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DRAC celebra su última reunión con la comunidad RISC-V poniendo en valor los resultados obtenidos en el proyecto y las herramientas para abordar los retos actuales y de futuro.
DRAC Final Event
[Tech] Nuevos resultados sobre ataques y medidas defensivas de canales laterales de memoria cache
[Tech] Añadiendo soporte hardware a la virtualización al procesador Sargantana
[Tech] Desarrollo de una plataforma de test específica para Sargantana
[Tech] Aceleración del alineamiento de secuencias genómicas con el algoritmo Wavefront en plataformas GPU
Quinta Reunión General
[Tech] Un modelo de seguridad para memorias caché con protección basada en aleatorización
[Tech] ¿Qué hay dentro del chip Sargantana?
[Tech] Sargantana, la tercera generación de procesadores Lagarto, enviada a fabricar via Europractice